仪器仪表商情网 技术分析 虽然SerDes接口在很多应用中很流行，但是对于不少高速系统，源同步的LVDS接口也依然存在。FPGA经常涉及到LVDS(Low Voltage Differential Signaling)信号的接收，比如说FPGA与一些采样率较高的ADC，或者一些高清显示屏的接口通常都是LVDS接口。这些信号有着一个共性，就是采用LVDS电平标准，采用源同步方式传输。由于这些信号速率一般很高，因此如何保证接收的这些信号的正确性，是一个FPGA设计者经常会遇到的难题。本文旨在提供一种简单方便的方法来稳定的接收该种方式的信号。
1.1 什么是LVDS信号？
LVDS的全称是Low Voltage Differential Signaling, 即低压差分信号。这是一种高速的，低摆幅，差分，低功耗的传输方式。最早该信号标准由美国国家半导体公司提出，后来被广泛用于各种高速接口，如LVDS液晶显示屏，高速ADC的数据接口，以及一些视频传输应用。
LVDS电平标准的电压摆幅是350 mV，由于其摆幅很低，因此上升时间很短，因此比起LVCMOS，LVTTL等电平标准具有更高的传输速度。理论上LVDS的传输最高速率可以达到1.9G b/s的水平。
