以Cyclone IV FPGA为样本，时序分析得到Slack为正，可以说明采用该方式接受LVDS信号是可以保证FPGA的采样是满足建立时间和保持时间，即为在外部硬件设计合理的情况下，FPGA可以保证在芯片的工作环境内能够正确稳定的接收该速率的LVDS信号。
结束语
高速器件输出LVDS信号给FPGA或者FPGA输出LVDS信号给外部高速器件是一个在很多场合都会应用到的场景，当LVDS信号速率在FPGA 采用源同步接收的LVDS I/O能力支持的情况下，FPGA可以使用源同步+输入约束的方式进行接收，这样可以简化设计，同时节省逻辑资源，让设计更加简单易懂。
关键词:仪器仪表 测试测量 技术分析 LVDS信号 浏览量：1404
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